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31 #if RTE_BYTE_ORDER == RTE_LITTLE_ENDIAN
36 #elif RTE_BYTE_ORDER == RTE_BIG_ENDIAN
43 #if RTE_BYTE_ORDER == RTE_LITTLE_ENDIAN
47 #elif RTE_BYTE_ORDER == RTE_BIG_ENDIAN
53 #if RTE_BYTE_ORDER == RTE_LITTLE_ENDIAN
56 #elif RTE_BYTE_ORDER == RTE_BIG_ENDIAN
64 #define RTE_ROCEV2_DEFAULT_PORT 4791